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Automated Technology for Verification and Analysis: 15th International Symposium, ATVA 2017, Pune, India, October 3–6, 2017, Proceedings

Automated Technology for Verification and Analysis: 15th International Symposium, ATVA 2017, Pune, India, October 3–6, 2017, Proceedings
Kataloginformation
Feldname Details
Vorliegende Sprache eng
ISBN 978-3-319-68166-5
Name D'Souza, Deepak ¬[Hrsg.]¬
Narayan Kumar, K. ¬[Hrsg.]¬
Name ANZEIGE DER KETTE Narayan Kumar, K. ¬[Hrsg.]¬
T I T E L Automated Technology for Verification and Analysis
Zusatz zum Titel 15th International Symposium, ATVA 2017, Pune, India, October 3–6, 2017, Proceedings
Verlagsort Cham
Verlag Springer
Erscheinungsjahr 2017
2017
Umfang Online-Ressource (XIX, 482 p. 106 illus, online resource)
Reihe Lecture Notes in Computer Science ; 10482
Lecture notes in computer science
Band 10482
Titelhinweis Druckausg.ISBN: 978-3-319-68166-5
Printed editionISBN: 978-3-319-68166-5
ISBN ISBN 978-3-319-68167-2
Klassifikation *68-06
68Q60
00B25
UMZ
COM051230
005.1
QA76.758
Kurzbeschreibung This book constitutes the refereed proceedings of the 15th International Symposium on Automated Technology for Verification and Analysis, ATVA 2017, held in Pune, India, in October 2017. The 22 full and 7 short papers presented in this volume were carefully reviewed and selected from 78 submissions. The book also contains one invited talk in full-paper length. The contributions are organized in topical sections named: program analysis; model checking and temporal logics; neural networks; learning and invariant synthesis; and hybrid systems and control
2. Kurzbeschreibung Invited Talk: Proving Absence of Starvation by Means of Abstract Interpretation and Model-checking -- Program Analysis -- Precise Null Pointer Analysis Through Global Value Numbering -- May-Happen-in-Parallel Analysis with Returned Futures -- JTDec: A Tool for Tree Decompositions in Soot -- Fixing the State Budget: Approximation of Regular Languages with Small DFAs -- An Equivalence Checking Framework for Array-Intensive Programs.-Loop Quasi-Invariant Chunk Detection -- SamaTulyata: An Efficient Path Based Equivalence Checking Tool -- Model Checking and Temporal Logics -- Tests and Refutation -- The Density of Linear-time Properties -- HyLeak: Hybrid Analysis Tool for Information Leakage -- Compositional Safety Refutation Techniques -- Gradient-based variable ordering of Decision Diagrams for systems with structural units -- Model Checking of C and C++ with DIVINE 4 (Tool Paper) -- Dealing with priorities and locks for concurrent programs -- Knowledge transfer and information leakage in protocols -- Concurrent Program Verification With Invariant-guided Underapproximation -- Neural Networks -- Maximum Resilience of Artificial Neural Networks -- Formal Verification of Piece-Wise Linear Feed-Forward Neural Networks -- Learning and Invariant Synthesis -- Liquid Types for Array Invariant Synthesis -- Lifting CDCL to Template-based Abstract Domains for Program Verification -- Synthesizing invariants by solving solvable loops -- Requirements and Specifications Exploiting Partial Knowledge for Efficient Model Analysis -- A Language-theoretic View on Network Protocols -- Probabilistic Systems Efficient Strategy Iteration for Mean Payoff in Markov Decision Processes -- Finding Polynomial Loop Invariants for Probabilistic Programs -- Synthesis of Optimal Resilient Control Strategies -- Hybrid Systems and Control -- ForFET: A Formal Feature Evaluation Tool for Hybrid Systems -- Attacking the V: On the Resiliency of Adaptive-Horizon MPC -- The Reach-Avoid Problem for Constant-Rate Multi-Mode Systems
1. Schlagwortkette Formale Methode
Verifikation
Systementwurf
Systemanalyse
Systemsynthese
CASHE
ANZEIGE DER KETTE Formale Methode -- Verifikation -- Systementwurf -- Systemanalyse -- Systemsynthese -- CASHE
SWB-Titel-Idn 495032174
Signatur Springer E-Book
Bemerkungen Elektronischer Volltext - Campuslizenz
Elektronische Adresse $uhttp://dx.doi.org/10.1007/978-3-319-68167-2
Internetseite / Link Volltext
Siehe auch Inhaltstext
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