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3D Video Coding for Embedded Devices: Energy Efficient Algorithms and Architectures
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Kataloginformation
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Kataloginformation
Feldname
Details
Vorliegende Sprache
eng
ISBN
978-1-4614-6758-8
Name
Zatt, Bruno
Shafique, Muhammad
Name ANZEIGE DER KETTE
Shafique, Muhammad
Name
Bampi, Sergio
Henkel, Jörg
T I T E L
3D Video Coding for Embedded Devices
Zusatz zum Titel
Energy Efficient Algorithms and Architectures
Verlagsort
New York, NY [u.a.]
Verlag
Springer
Erscheinungsjahr
2013
2013
Umfang
Online-Ressource (XIX, 204 p. 126 illus., 112 illus. in color, digital)
Reihe
SpringerLink. Bücher
Notiz / Fußnoten
Includes bibliographical references and index
Weiterer Inhalt
Introduction -- Background and Related Work -- Multiview Video Coding Analysis for Energy and Quality -- Energy-Effiecient Algorithms for Multiview Video Coding -- Energy-Efficient Architectures for Multiview Video Coding -- Results and Comparison -- Conclusion and future Works.
Titelhinweis
Druckausg.ISBN: 978-1-461-46758-8
ISBN
ISBN 978-1-4614-6759-5
Klassifikation
TJFC
TEC008010
621.3815
TK7888.4
Kurzbeschreibung
This book shows readers how to develop energy-efficient algorithms and hardware architectures to enable high-definition 3D video coding on resource-constrained embedded devices. Users of the Multiview Video Coding (MVC) standard face the challenge of exploiting its 3D video-specific coding tools for increasing compression efficiency at the cost of increasing computational complexity and, consequently, the energy consumption. This book enables readers to reduce the multiview video coding energy consumption through jointly considering the algorithmic and architectural levels. Coverage includes an introduction to 3D videos and an extensive discussion of the current state-of-the-art of 3D video coding, as well as energy-efficient algorithms for 3D video coding and energy-efficient hardware architecture for 3D video coding. · Discusses challenges related to performance and power in 3D video coding for embedded devices;· Describes energy-efficient algorithms for reducing computational complexity at multiple hierarchical levels;· Presents energy-efficient hardware architectures along with methods for reducing on-chip and off-chip energy related to both data processing and memory access;· Shows how to leverage jointly the algorithm and hardware architecture layers of the system
SWB-Titel-Idn
381841014
Signatur
Springer E-Book
Bemerkungen
Elektronischer Volltext - Campuslizenz
Elektronische Adresse
$uhttp://dx.doi.org/10.1007/978-1-4614-6759-5
Internetseite / Link
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