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Background Calibration of Time-Interleaved Data Converters

Background Calibration of Time-Interleaved Data Converters
Kataloginformation
Feldname Details
Vorliegende Sprache eng
ISBN 978-1-4614-1510-7
Name El-Chammas, Manar
Murmann, Boris
ANZEIGE DER KETTE Murmann, Boris
T I T E L Background Calibration of Time-Interleaved Data Converters
Verlagsort New York, NY
Verlag Springer New York
Erscheinungsjahr 2012
2012
Umfang Online-Ressource (XIX, 123p. 73 illus, digital)
Reihe Analog Circuits and Signal Processing
Notiz / Fußnoten Includes bibliographical references (p. 115-120) and index
Weiterer Inhalt Background Calibration of Time-Interleaved Data Converters; Preface; Contents; List of Figures; List of Tables; Acronyms; Chapter 1 Introduction; 1.1 Overview; 1.2 Chapter Organization; Chapter 2 Time-Interleaved ADCs; 2.1 Modeling the Time-Interleaved ADC; 2.1.1 Frequency Domain Analysis; 2.1.1.1 Sub-ADC Output; 2.1.1.2 Time-Interleaved ADC Output; 2.1.1.3 Interpretation; 2.2 The Effect of Time-Varying Errors; 2.2.1 Frequency Domain Analysis; 2.2.1.1 Effect of Offset Mismatch; 2.2.1.2 Effect of Gain Mismatch; 2.2.1.3 Effect of Timing Skew; 2.3 Quantitative Error Analysis. 2.3.1 Error Analysis Method2.3.2 Impact of Offset; 2.3.3 Impact of Gain; 2.3.4 Impact of Timing Skew; 2.3.4.1 Wide-Sense Cyclostationary Signals; 2.3.4.2 Jitter; 2.3.5 Simulation Examples; 2.3.5.1 Examples for Deterministic Bounds; 2.3.5.2 Ideal Filter; 2.3.5.3 First-Order Low Pass Filter; 2.3.5.4 Examples for Statistical Bounds; 2.3.5.5 Ideal Filter; 2.3.5.6 Second-Order Low Pass Filter; 2.3.5.7 Example of Deterministic Bound for WSCS Signals; 2.4 Summary; Chapter 3 Mitigation of Timing Skew; 3.1 Bounds on Timing Skew; 3.2 Sources of Timing Skew; 3.2.1 Transistor Variations. 3.2.2 Trace and Load Variations3.2.3 Cumulative Effects of Variations; 3.3 Timing Skew Mitigation; 3.4 Background Timing Skew Calibration; 3.4.1 Calculating the Correlation; 3.4.2 Maximizing the Correlation; 3.4.3 Simplifying the Algorithm; 3.4.3.1 Reducing the Resolution of the Calibration ADC; 3.4.3.2 Decreasing the Sampling Frequency of the Calibration ADC; 3.4.4 Calibrating All the Sub-ADCs; 3.4.4.1 Clocking the Calibration ADC; 3.5 Algorithmic Behavior; 3.5.1 Convergence Speed; 3.5.1.1 Required Number of Samples; 3.5.1.2 Digital Algorithm; 3.5.2 Conditions on Input Signal. 3.5.3 Effect of Quantization3.6 Summary; Chapter 4 Architecture Optimization; 4.1 Power Dissipation; 4.1.1 Dynamic Comparator First-Order Model; 4.1.1.1 Dynamic Comparator Regeneration Time; 4.1.1.2 Comparator Metastability; 4.1.2 Dynamic Comparator Power; 4.2 First-Order Optimization Framework; 4.2.1 Performance Limits; 4.2.2 Optimization Analysis; 4.2.2.1 Example; 4.2.2.2 Example with Resistor Ladder; 4.2.2.3 Framework Limitations; 4.3 A Circuit-Oriented Optimization Approach; 4.4 Summary; Chapter 5 Circuit Design; 5.1 The Sub-ADC; 5.1.1 Bootstrapped Track-and-Hold; 5.1.2 Comparator Design. 5.1.2.1 Design Considerations5.1.2.2 Comparator Offset Correction; 5.1.3 Resistor Ladder; 5.1.4 Wallace Encoder; 5.2 The Delay Line; 5.2.1 The Delay Cell; 5.2.1.1 Variable Capacitive Load; 5.2.2 Cascaded Delay Cells; 5.3 Phase Generator; 5.4 Output Buffers; 5.4.1 Level Converter; 5.4.2 LVDS Driver; 5.5 Summary; Chapter 6 Measurement Results; 6.1 Test Setup; 6.1.1 Device Under Test; 6.1.2 Printed Circuit Board; 6.1.3 Data Capture Cards; 6.1.4 Computer; 6.2 ADC Measurement Results; 6.2.1 Static Performance; 6.2.2 Timing Skew Calibration; 6.2.3 Dynamic Performance; 6.2.4 Performance Summary. 6.2.5 Comparisons
Titelhinweis Buchausg. u.d.T.ISBN: 978-1-4614-1510-7
ISBN ISBN 978-1-4614-1511-4
Klassifikation TJFC
TEC008010
621.3815
621.3815/9
621.39814
TK7888.4
Kurzbeschreibung Annotation, This book describes techniques for time-interleaving a number of analog-to-digital data converters to achieve demanding bandwidth requirements. Readers will benefit from the presentation of a low-power solution that can be used in actual products, while alleviating the time-varying signal artifacts that typically arise when implementing such a system architecture
SWB-Titel-Idn 356124991
Signatur Springer E-Book
Bemerkungen Elektronischer Volltext - Campuslizenz
Elektronische Adresse $uhttp://dx.doi.org/10.1007/978-1-4614-1511-4
Internetseite / Link Volltext
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